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gpio: atmel: Add the PIO4 driver support
The PIO4 is introduced from SAMA5D2, as a new version for Atmel PIO controller. Signed-off-by: Wenyou Yang <wenyou.yang@atmel.com>
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fa8883a1e3
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2c62c56a86
4 changed files with 356 additions and 0 deletions
48
arch/arm/mach-at91/include/mach/atmel_pio4.h
Normal file
48
arch/arm/mach-at91/include/mach/atmel_pio4.h
Normal file
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@ -0,0 +1,48 @@
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/*
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* Copyright (C) 2015 Atmel Corporation.
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* Wenyou Yang <wenyou.yang@atmel.com>
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*
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* SPDX-License-Identifier: GPL-2.0+
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*/
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#ifndef __ATMEL_PIO4_H
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#define __ATMEL_PIO4_H
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#ifndef __ASSEMBLY__
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struct atmel_pio4_port {
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u32 mskr; /* 0x00 PIO Mask Register */
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u32 cfgr; /* 0x04 PIO Configuration Register */
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u32 pdsr; /* 0x08 PIO Pin Data Status Register */
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u32 locksr; /* 0x0C PIO Lock Status Register */
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u32 sodr; /* 0x10 PIO Set Output Data Register */
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u32 codr; /* 0x14 PIO Clear Output Data Register */
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u32 odsr; /* 0x18 PIO Output Data Status Register */
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u32 reserved0;
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u32 ier; /* 0x20 PIO Interrupt Enable Register */
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u32 idr; /* 0x24 PIO Interrupt Disable Register */
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u32 imr; /* 0x28 PIO Interrupt Mask Register */
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u32 isr; /* 0x2C PIO Interrupt Status Register */
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u32 reserved1[3];
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u32 iofr; /* 0x3C PIO I/O Freeze Register */
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};
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#endif
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#define AT91_PIO_PORTA 0x0
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#define AT91_PIO_PORTB 0x1
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#define AT91_PIO_PORTC 0x2
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#define AT91_PIO_PORTD 0x3
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int atmel_pio4_set_gpio(u32 port, u32 pin, u32 use_pullup);
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||||||
|
int atmel_pio4_set_a_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_b_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_c_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_d_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_e_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_f_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_g_periph(u32 port, u32 pin, u32 use_pullup);
|
||||||
|
int atmel_pio4_set_pio_output(u32 port, u32 pin, u32 value);
|
||||||
|
int atmel_pio4_get_pio_input(u32 port, u32 pin);
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#endif
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@ -28,6 +28,17 @@ config DWAPB_GPIO
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help
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help
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Support for the Designware APB GPIO driver.
|
Support for the Designware APB GPIO driver.
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config ATMEL_PIO4
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bool "ATMEL PIO4 driver"
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depends on DM
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default n
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help
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Say yes here to support the Atmel PIO4 driver.
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The PIO4 is new version of Atmel PIO controller, which manages
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up to 128 fully programmable input/output lines. Each I/O line
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may be dedicated as a general purpose I/O or be assigned to
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a function of an embedded peripheral.
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config LPC32XX_GPIO
|
config LPC32XX_GPIO
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||||||
bool "LPC32XX GPIO driver"
|
bool "LPC32XX GPIO driver"
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||||||
depends on DM
|
depends on DM
|
||||||
|
|
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@ -12,6 +12,7 @@ endif
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||||||
obj-$(CONFIG_DM_GPIO) += gpio-uclass.o
|
obj-$(CONFIG_DM_GPIO) += gpio-uclass.o
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||||||
|
|
||||||
obj-$(CONFIG_AT91_GPIO) += at91_gpio.o
|
obj-$(CONFIG_AT91_GPIO) += at91_gpio.o
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||||||
|
obj-$(CONFIG_ATMEL_PIO4) += atmel_pio4.o
|
||||||
obj-$(CONFIG_INTEL_ICH6_GPIO) += intel_ich6_gpio.o
|
obj-$(CONFIG_INTEL_ICH6_GPIO) += intel_ich6_gpio.o
|
||||||
obj-$(CONFIG_KIRKWOOD_GPIO) += kw_gpio.o
|
obj-$(CONFIG_KIRKWOOD_GPIO) += kw_gpio.o
|
||||||
obj-$(CONFIG_KONA_GPIO) += kona_gpio.o
|
obj-$(CONFIG_KONA_GPIO) += kona_gpio.o
|
||||||
|
|
296
drivers/gpio/atmel_pio4.c
Normal file
296
drivers/gpio/atmel_pio4.c
Normal file
|
@ -0,0 +1,296 @@
|
||||||
|
/*
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|
* Atmel PIO4 device driver
|
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|
*
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|
* Copyright (C) 2015 Atmel Corporation
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|
* Wenyou.Yang <wenyou.yang@atmel.com>
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|
*
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|
* SPDX-License-Identifier: GPL-2.0+
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|
*/
|
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|
#include <common.h>
|
||||||
|
#include <dm.h>
|
||||||
|
#include <asm/arch/hardware.h>
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|
#include <mach/gpio.h>
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|
#include <mach/atmel_pio4.h>
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|
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|
#define ATMEL_PIO4_PINS_PER_BANK 32
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/*
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* Register Field Definitions
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*/
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|
#define ATMEL_PIO4_CFGR_FUNC (0x7 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_GPIO (0x0 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_A (0x1 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_B (0x2 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_C (0x3 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_D (0x4 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_E (0x5 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_F (0x6 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_FUNC_PERIPH_G (0x7 << 0)
|
||||||
|
#define ATMEL_PIO4_CFGR_DIR (0x1 << 8)
|
||||||
|
#define ATMEL_PIO4_CFGR_PUEN (0x1 << 9)
|
||||||
|
#define ATMEL_PIO4_CFGR_PDEN (0x1 << 10)
|
||||||
|
#define ATMEL_PIO4_CFGR_IFEN (0x1 << 12)
|
||||||
|
#define ATMEL_PIO4_CFGR_IFSCEN (0x1 << 13)
|
||||||
|
#define ATMEL_PIO4_CFGR_OPD (0x1 << 14)
|
||||||
|
#define ATMEL_PIO4_CFGR_SCHMITT (0x1 << 15)
|
||||||
|
#define ATMEL_PIO4_CFGR_DRVSTR (0x3 << 16)
|
||||||
|
#define ATMEL_PIO4_CFGR_DRVSTR_LOW0 (0x0 << 16)
|
||||||
|
#define ATMEL_PIO4_CFGR_DRVSTR_LOW1 (0x1 << 16)
|
||||||
|
#define ATMEL_PIO4_CFGR_DRVSTR_MEDIUM (0x2 << 16)
|
||||||
|
#define ATMEL_PIO4_CFGR_DRVSTR_HIGH (0x3 << 16)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL (0x7 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL_FALLING (0x0 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL_RISING (0x1 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL_BOTH (0x2 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL_LOW (0x3 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_EVTSEL_HIGH (0x4 << 24)
|
||||||
|
#define ATMEL_PIO4_CFGR_PCFS (0x1 << 29)
|
||||||
|
#define ATMEL_PIO4_CFGR_ICFS (0x1 << 30)
|
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|
|
||||||
|
static struct atmel_pio4_port *atmel_pio4_port_base(u32 port)
|
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|
{
|
||||||
|
struct atmel_pio4_port *base = NULL;
|
||||||
|
|
||||||
|
switch (port) {
|
||||||
|
case AT91_PIO_PORTA:
|
||||||
|
base = (struct atmel_pio4_port *)ATMEL_BASE_PIOA;
|
||||||
|
break;
|
||||||
|
case AT91_PIO_PORTB:
|
||||||
|
base = (struct atmel_pio4_port *)ATMEL_BASE_PIOB;
|
||||||
|
break;
|
||||||
|
case AT91_PIO_PORTC:
|
||||||
|
base = (struct atmel_pio4_port *)ATMEL_BASE_PIOC;
|
||||||
|
break;
|
||||||
|
case AT91_PIO_PORTD:
|
||||||
|
base = (struct atmel_pio4_port *)ATMEL_BASE_PIOD;
|
||||||
|
break;
|
||||||
|
default:
|
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|
printf("Error: Atmel PIO4: Failed to get PIO base of port#%d!\n",
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|
port);
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
return base;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int atmel_pio4_config_io_func(u32 port, u32 pin,
|
||||||
|
u32 func, u32 use_pullup)
|
||||||
|
{
|
||||||
|
struct atmel_pio4_port *port_base;
|
||||||
|
u32 reg, mask;
|
||||||
|
|
||||||
|
if (pin >= ATMEL_PIO4_PINS_PER_BANK)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
port_base = atmel_pio4_port_base(port);
|
||||||
|
if (!port_base)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
mask = 1 << pin;
|
||||||
|
reg = func;
|
||||||
|
reg |= use_pullup ? ATMEL_PIO4_CFGR_PUEN : 0;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
writel(reg, &port_base->cfgr);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_gpio(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_GPIO,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_a_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_A,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_b_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_B,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_c_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_C,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_d_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_D,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_e_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_E,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_f_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_F,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_g_periph(u32 port, u32 pin, u32 use_pullup)
|
||||||
|
{
|
||||||
|
return atmel_pio4_config_io_func(port, pin,
|
||||||
|
ATMEL_PIO4_CFGR_FUNC_PERIPH_G,
|
||||||
|
use_pullup);
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_set_pio_output(u32 port, u32 pin, u32 value)
|
||||||
|
{
|
||||||
|
struct atmel_pio4_port *port_base;
|
||||||
|
u32 reg, mask;
|
||||||
|
|
||||||
|
if (pin >= ATMEL_PIO4_PINS_PER_BANK)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
port_base = atmel_pio4_port_base(port);
|
||||||
|
if (!port_base)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
mask = 0x01 << pin;
|
||||||
|
reg = ATMEL_PIO4_CFGR_FUNC_GPIO | ATMEL_PIO4_CFGR_DIR;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
writel(reg, &port_base->cfgr);
|
||||||
|
|
||||||
|
if (value)
|
||||||
|
writel(mask, &port_base->sodr);
|
||||||
|
else
|
||||||
|
writel(mask, &port_base->codr);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
int atmel_pio4_get_pio_input(u32 port, u32 pin)
|
||||||
|
{
|
||||||
|
struct atmel_pio4_port *port_base;
|
||||||
|
u32 reg, mask;
|
||||||
|
|
||||||
|
if (pin >= ATMEL_PIO4_PINS_PER_BANK)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
port_base = atmel_pio4_port_base(port);
|
||||||
|
if (!port_base)
|
||||||
|
return -ENODEV;
|
||||||
|
|
||||||
|
mask = 0x01 << pin;
|
||||||
|
reg = ATMEL_PIO4_CFGR_FUNC_GPIO;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
writel(reg, &port_base->cfgr);
|
||||||
|
|
||||||
|
return (readl(&port_base->pdsr) & mask) ? 1 : 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
#ifdef CONFIG_DM_GPIO
|
||||||
|
static int atmel_pio4_direction_input(struct udevice *dev, unsigned offset)
|
||||||
|
{
|
||||||
|
struct at91_port_platdata *plat = dev_get_platdata(dev);
|
||||||
|
struct atmel_pio4_port *port_base = (atmel_pio4_port *)plat->base_addr;
|
||||||
|
u32 mask = 0x01 << offset;
|
||||||
|
u32 reg = ATMEL_PIO4_CFGR_FUNC_GPIO;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
writel(reg, &port_base->cfgr);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int atmel_pio4_direction_output(struct udevice *dev,
|
||||||
|
unsigned offset, int value)
|
||||||
|
{
|
||||||
|
struct at91_port_platdata *plat = dev_get_platdata(dev);
|
||||||
|
struct atmel_pio4_port *port_base = (atmel_pio4_port *)plat->base_addr;
|
||||||
|
u32 mask = 0x01 << offset;
|
||||||
|
u32 reg = ATMEL_PIO4_CFGR_FUNC_GPIO | ATMEL_PIO4_CFGR_DIR;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
writel(reg, &port_base->cfgr);
|
||||||
|
|
||||||
|
if (value)
|
||||||
|
writel(mask, &port_base->sodr);
|
||||||
|
else
|
||||||
|
writel(mask, &port_base->codr);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int atmel_pio4_get_value(struct udevice *dev, unsigned offset)
|
||||||
|
{
|
||||||
|
struct at91_port_platdata *plat = dev_get_platdata(dev);
|
||||||
|
struct atmel_pio4_port *port_base = (atmel_pio4_port *)plat->base_addr;
|
||||||
|
u32 mask = 0x01 << offset;
|
||||||
|
|
||||||
|
return (readl(&port_base->pdsr) & mask) ? 1 : 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int atmel_pio4_set_value(struct udevice *dev,
|
||||||
|
unsigned offset, int value)
|
||||||
|
{
|
||||||
|
struct at91_port_platdata *plat = dev_get_platdata(dev);
|
||||||
|
struct atmel_pio4_port *port_base = (atmel_pio4_port *)plat->base_addr;
|
||||||
|
u32 mask = 0x01 << offset;
|
||||||
|
|
||||||
|
if (value)
|
||||||
|
writel(mask, &port_base->sodr);
|
||||||
|
else
|
||||||
|
writel(mask, &port_base->codr);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int atmel_pio4_get_function(struct udevice *dev, unsigned offset)
|
||||||
|
{
|
||||||
|
struct at91_port_platdata *plat = dev_get_platdata(dev);
|
||||||
|
struct atmel_pio4_port *port_base = (atmel_pio4_port *)plat->base_addr;
|
||||||
|
u32 mask = 0x01 << offset;
|
||||||
|
|
||||||
|
writel(mask, &port_base->mskr);
|
||||||
|
|
||||||
|
return (readl(&port_base->cfgr) &
|
||||||
|
ATMEL_PIO4_CFGR_DIR) ? GPIOF_OUTPUT : GPIOF_INPUT;
|
||||||
|
}
|
||||||
|
|
||||||
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static const struct dm_gpio_ops atmel_pio4_ops = {
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.direction_input = atmel_pio4_direction_input,
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.direction_output = atmel_pio4_direction_output,
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||||||
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.get_value = atmel_pio4_get_value,
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.set_value = atmel_pio4_set_value,
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.get_function = atmel_pio4_get_function,
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};
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static int atmel_pio4_probe(struct udevice *dev)
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{
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struct at91_port_platdata *plat = dev_get_platdata(dev);
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struct gpio_dev_priv *uc_priv = dev_get_uclass_priv(dev);
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uc_priv->bank_name = plat->bank_name;
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uc_priv->gpio_count = ATMEL_PIO4_PINS_PER_BANK;
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return 0;
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}
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U_BOOT_DRIVER(gpio_atmel_pio4) = {
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.name = "gpio_atmel_pio4",
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.id = UCLASS_GPIO,
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.ops = &atmel_pio4_ops,
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||||||
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.probe = atmel_pio4_probe,
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|
};
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||||||
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#endif
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