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synced 2025-03-31 11:31:32 +00:00
x86: broadwell: Allow SDRAM init from SPL
At present, for broadwell, SDRAM is always set up in U-Boot proper since the 64-bit mode (which uses SDRAM init in SPL) is not supported. Update the code to allow SDRAM init in SPL instead so that U-Boot proper can be loaded into SDRAM and run from there. This allows U-Boot to be compressed to reduce space, since it is not necessary to run it directly from flash. It could later allow us to support 64-bit U-Boot on broadwell. Signed-off-by: Simon Glass <sjg@chromium.org> Reviewed-by: Bin Meng <bmeng.cn@gmail.com>
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Simon Glass
Bin Meng
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9f6486bff4
commit
4eabf1e54b
3 changed files with 101 additions and 94 deletions
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@ -13,4 +13,4 @@ obj-y += pinctrl_broadwell.o
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obj-y += power_state.o
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obj-y += power_state.o
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obj-y += refcode.o
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obj-y += refcode.o
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obj-y += sata.o
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obj-y += sata.o
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obj-y += sdram.o
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obj-$(CONFIG_$(SPL_TPL_)X86_32BIT_INIT) += sdram.o
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@ -6,8 +6,108 @@
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#include <common.h>
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#include <common.h>
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#include <dm.h>
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#include <dm.h>
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#include <asm/io.h>
|
#include <asm/io.h>
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#include <asm/mrc_common.h>
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#include <asm/arch/iomap.h>
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#include <asm/arch/iomap.h>
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#include <asm/arch/pch.h>
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#include <asm/arch/pch.h>
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#include <asm/arch/pei_data.h>
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__weak asmlinkage void sdram_console_tx_byte(unsigned char byte)
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{
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#ifdef DEBUG
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putc(byte);
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#endif
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}
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void broadwell_fill_pei_data(struct pei_data *pei_data)
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{
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pei_data->pei_version = PEI_VERSION;
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pei_data->board_type = BOARD_TYPE_ULT;
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pei_data->pciexbar = MCFG_BASE_ADDRESS;
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pei_data->smbusbar = SMBUS_BASE_ADDRESS;
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pei_data->ehcibar = EARLY_EHCI_BAR;
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pei_data->xhcibar = EARLY_XHCI_BAR;
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pei_data->gttbar = EARLY_GTT_BAR;
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pei_data->pmbase = ACPI_BASE_ADDRESS;
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pei_data->gpiobase = GPIO_BASE_ADDRESS;
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pei_data->tseg_size = CONFIG_SMM_TSEG_SIZE;
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pei_data->temp_mmio_base = EARLY_TEMP_MMIO;
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pei_data->tx_byte = sdram_console_tx_byte;
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pei_data->ddr_refresh_2x = 1;
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}
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static void pei_data_usb2_port(struct pei_data *pei_data, int port, uint length,
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uint enable, uint oc_pin, uint location)
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{
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pei_data->usb2_ports[port].length = length;
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pei_data->usb2_ports[port].enable = enable;
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pei_data->usb2_ports[port].oc_pin = oc_pin;
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pei_data->usb2_ports[port].location = location;
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}
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static void pei_data_usb3_port(struct pei_data *pei_data, int port, uint enable,
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uint oc_pin, uint fixed_eq)
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|
{
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|
pei_data->usb3_ports[port].enable = enable;
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||||||
|
pei_data->usb3_ports[port].oc_pin = oc_pin;
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||||||
|
pei_data->usb3_ports[port].fixed_eq = fixed_eq;
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}
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void mainboard_fill_pei_data(struct pei_data *pei_data)
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{
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/* DQ byte map for Samus board */
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const u8 dq_map[2][6][2] = {
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{ { 0x0F, 0xF0 }, { 0x00, 0xF0 }, { 0x0F, 0xF0 },
|
||||||
|
{ 0x0F, 0x00 }, { 0xFF, 0x00 }, { 0xFF, 0x00 } },
|
||||||
|
{ { 0x0F, 0xF0 }, { 0x00, 0xF0 }, { 0x0F, 0xF0 },
|
||||||
|
{ 0x0F, 0x00 }, { 0xFF, 0x00 }, { 0xFF, 0x00 } } };
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||||||
|
/* DQS CPU<>DRAM map for Samus board */
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|
const u8 dqs_map[2][8] = {
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||||||
|
{ 2, 0, 1, 3, 6, 4, 7, 5 },
|
||||||
|
{ 2, 1, 0, 3, 6, 5, 4, 7 } };
|
||||||
|
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||||||
|
pei_data->ec_present = 1;
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||||||
|
/* One installed DIMM per channel */
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pei_data->dimm_channel0_disabled = 2;
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|
pei_data->dimm_channel1_disabled = 2;
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||||||
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|
memcpy(pei_data->dq_map, dq_map, sizeof(dq_map));
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||||||
|
memcpy(pei_data->dqs_map, dqs_map, sizeof(dqs_map));
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||||||
|
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||||||
|
/* P0: HOST PORT */
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||||||
|
pei_data_usb2_port(pei_data, 0, 0x0080, 1, 0,
|
||||||
|
USB_PORT_BACK_PANEL);
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||||||
|
/* P1: HOST PORT */
|
||||||
|
pei_data_usb2_port(pei_data, 1, 0x0080, 1, 1,
|
||||||
|
USB_PORT_BACK_PANEL);
|
||||||
|
/* P2: RAIDEN */
|
||||||
|
pei_data_usb2_port(pei_data, 2, 0x0080, 1, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_BACK_PANEL);
|
||||||
|
/* P3: SD CARD */
|
||||||
|
pei_data_usb2_port(pei_data, 3, 0x0040, 1, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_INTERNAL);
|
||||||
|
/* P4: RAIDEN */
|
||||||
|
pei_data_usb2_port(pei_data, 4, 0x0080, 1, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_BACK_PANEL);
|
||||||
|
/* P5: WWAN (Disabled) */
|
||||||
|
pei_data_usb2_port(pei_data, 5, 0x0000, 0, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_SKIP);
|
||||||
|
/* P6: CAMERA */
|
||||||
|
pei_data_usb2_port(pei_data, 6, 0x0040, 1, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_INTERNAL);
|
||||||
|
/* P7: BT */
|
||||||
|
pei_data_usb2_port(pei_data, 7, 0x0040, 1, USB_OC_PIN_SKIP,
|
||||||
|
USB_PORT_INTERNAL);
|
||||||
|
|
||||||
|
/* P1: HOST PORT */
|
||||||
|
pei_data_usb3_port(pei_data, 0, 1, 0, 0);
|
||||||
|
/* P2: HOST PORT */
|
||||||
|
pei_data_usb3_port(pei_data, 1, 1, 1, 0);
|
||||||
|
/* P3: RAIDEN */
|
||||||
|
pei_data_usb3_port(pei_data, 2, 1, USB_OC_PIN_SKIP, 0);
|
||||||
|
/* P4: RAIDEN */
|
||||||
|
pei_data_usb3_port(pei_data, 3, 1, USB_OC_PIN_SKIP, 0);
|
||||||
|
}
|
||||||
|
|
||||||
static int broadwell_northbridge_early_init(struct udevice *dev)
|
static int broadwell_northbridge_early_init(struct udevice *dev)
|
||||||
{
|
{
|
||||||
|
|
|
||||||
|
|
@ -34,99 +34,6 @@ int dram_init_banksize(void)
|
||||||
return 0;
|
return 0;
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}
|
}
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||||||
|
|
||||||
void broadwell_fill_pei_data(struct pei_data *pei_data)
|
|
||||||
{
|
|
||||||
pei_data->pei_version = PEI_VERSION;
|
|
||||||
pei_data->board_type = BOARD_TYPE_ULT;
|
|
||||||
pei_data->pciexbar = MCFG_BASE_ADDRESS;
|
|
||||||
pei_data->smbusbar = SMBUS_BASE_ADDRESS;
|
|
||||||
pei_data->ehcibar = EARLY_EHCI_BAR;
|
|
||||||
pei_data->xhcibar = EARLY_XHCI_BAR;
|
|
||||||
pei_data->gttbar = EARLY_GTT_BAR;
|
|
||||||
pei_data->pmbase = ACPI_BASE_ADDRESS;
|
|
||||||
pei_data->gpiobase = GPIO_BASE_ADDRESS;
|
|
||||||
pei_data->tseg_size = CONFIG_SMM_TSEG_SIZE;
|
|
||||||
pei_data->temp_mmio_base = EARLY_TEMP_MMIO;
|
|
||||||
pei_data->tx_byte = sdram_console_tx_byte;
|
|
||||||
pei_data->ddr_refresh_2x = 1;
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|
||||||
}
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||||||
|
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||||||
static inline void pei_data_usb2_port(struct pei_data *pei_data, int port,
|
|
||||||
uint16_t length, uint8_t enable,
|
|
||||||
uint8_t oc_pin, uint8_t location)
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||||||
{
|
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||||||
pei_data->usb2_ports[port].length = length;
|
|
||||||
pei_data->usb2_ports[port].enable = enable;
|
|
||||||
pei_data->usb2_ports[port].oc_pin = oc_pin;
|
|
||||||
pei_data->usb2_ports[port].location = location;
|
|
||||||
}
|
|
||||||
|
|
||||||
static inline void pei_data_usb3_port(struct pei_data *pei_data, int port,
|
|
||||||
uint8_t enable, uint8_t oc_pin,
|
|
||||||
uint8_t fixed_eq)
|
|
||||||
{
|
|
||||||
pei_data->usb3_ports[port].enable = enable;
|
|
||||||
pei_data->usb3_ports[port].oc_pin = oc_pin;
|
|
||||||
pei_data->usb3_ports[port].fixed_eq = fixed_eq;
|
|
||||||
}
|
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||||||
|
|
||||||
void mainboard_fill_pei_data(struct pei_data *pei_data)
|
|
||||||
{
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||||||
/* DQ byte map for Samus board */
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||||||
const u8 dq_map[2][6][2] = {
|
|
||||||
{ { 0x0F, 0xF0 }, { 0x00, 0xF0 }, { 0x0F, 0xF0 },
|
|
||||||
{ 0x0F, 0x00 }, { 0xFF, 0x00 }, { 0xFF, 0x00 } },
|
|
||||||
{ { 0x0F, 0xF0 }, { 0x00, 0xF0 }, { 0x0F, 0xF0 },
|
|
||||||
{ 0x0F, 0x00 }, { 0xFF, 0x00 }, { 0xFF, 0x00 } } };
|
|
||||||
/* DQS CPU<>DRAM map for Samus board */
|
|
||||||
const u8 dqs_map[2][8] = {
|
|
||||||
{ 2, 0, 1, 3, 6, 4, 7, 5 },
|
|
||||||
{ 2, 1, 0, 3, 6, 5, 4, 7 } };
|
|
||||||
|
|
||||||
pei_data->ec_present = 1;
|
|
||||||
|
|
||||||
/* One installed DIMM per channel */
|
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||||||
pei_data->dimm_channel0_disabled = 2;
|
|
||||||
pei_data->dimm_channel1_disabled = 2;
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|
||||||
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||||||
memcpy(pei_data->dq_map, dq_map, sizeof(dq_map));
|
|
||||||
memcpy(pei_data->dqs_map, dqs_map, sizeof(dqs_map));
|
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||||||
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||||||
/* P0: HOST PORT */
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pei_data_usb2_port(pei_data, 0, 0x0080, 1, 0,
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USB_PORT_BACK_PANEL);
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/* P1: HOST PORT */
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||||||
pei_data_usb2_port(pei_data, 1, 0x0080, 1, 1,
|
|
||||||
USB_PORT_BACK_PANEL);
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||||||
/* P2: RAIDEN */
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||||||
pei_data_usb2_port(pei_data, 2, 0x0080, 1, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_BACK_PANEL);
|
|
||||||
/* P3: SD CARD */
|
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||||||
pei_data_usb2_port(pei_data, 3, 0x0040, 1, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_INTERNAL);
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||||||
/* P4: RAIDEN */
|
|
||||||
pei_data_usb2_port(pei_data, 4, 0x0080, 1, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_BACK_PANEL);
|
|
||||||
/* P5: WWAN (Disabled) */
|
|
||||||
pei_data_usb2_port(pei_data, 5, 0x0000, 0, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_SKIP);
|
|
||||||
/* P6: CAMERA */
|
|
||||||
pei_data_usb2_port(pei_data, 6, 0x0040, 1, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_INTERNAL);
|
|
||||||
/* P7: BT */
|
|
||||||
pei_data_usb2_port(pei_data, 7, 0x0040, 1, USB_OC_PIN_SKIP,
|
|
||||||
USB_PORT_INTERNAL);
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|
||||||
|
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||||||
/* P1: HOST PORT */
|
|
||||||
pei_data_usb3_port(pei_data, 0, 1, 0, 0);
|
|
||||||
/* P2: HOST PORT */
|
|
||||||
pei_data_usb3_port(pei_data, 1, 1, 1, 0);
|
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||||||
/* P3: RAIDEN */
|
|
||||||
pei_data_usb3_port(pei_data, 2, 1, USB_OC_PIN_SKIP, 0);
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|
||||||
/* P4: RAIDEN */
|
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||||||
pei_data_usb3_port(pei_data, 3, 1, USB_OC_PIN_SKIP, 0);
|
|
||||||
}
|
|
||||||
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static unsigned long get_top_of_ram(struct udevice *dev)
|
static unsigned long get_top_of_ram(struct udevice *dev)
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{
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{
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/*
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/*
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