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mtd: nand: Remove jz4740 driver
This driver is not used by anyone, remove it. Signed-off-by: Marek Vasut <marex@denx.de> Cc: Daniel Schwierzeck <daniel.schwierzeck@gmail.com> Cc: Paul Burton <paul.burton@imgtec.com> Cc: Scott Wood <oss@buserror.net> Acked-by: Daniel Schwierzeck <daniel.schwierzeck@gmail.com> Signed-off-by: Scott Wood <oss@buserror.net>
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Marek Vasut
Scott Wood
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a39d14406a
commit
5d74e3a6f1
2 changed files with 0 additions and 259 deletions
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@ -50,7 +50,6 @@ obj-$(CONFIG_NAND_FSL_ELBC) += fsl_elbc_nand.o
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obj-$(CONFIG_NAND_FSL_IFC) += fsl_ifc_nand.o
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obj-$(CONFIG_NAND_FSL_IFC) += fsl_ifc_nand.o
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obj-$(CONFIG_NAND_FSL_UPM) += fsl_upm.o
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obj-$(CONFIG_NAND_FSL_UPM) += fsl_upm.o
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obj-$(CONFIG_NAND_FSMC) += fsmc_nand.o
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obj-$(CONFIG_NAND_FSMC) += fsmc_nand.o
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obj-$(CONFIG_NAND_JZ4740) += jz4740_nand.o
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obj-$(CONFIG_NAND_KB9202) += kb9202_nand.o
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obj-$(CONFIG_NAND_KB9202) += kb9202_nand.o
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obj-$(CONFIG_NAND_KIRKWOOD) += kirkwood_nand.o
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obj-$(CONFIG_NAND_KIRKWOOD) += kirkwood_nand.o
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obj-$(CONFIG_NAND_KMETER1) += kmeter1_nand.o
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obj-$(CONFIG_NAND_KMETER1) += kmeter1_nand.o
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@ -1,258 +0,0 @@
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/*
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* Platform independend driver for JZ4740.
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*
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* Copyright (c) 2007 Ingenic Semiconductor Inc.
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||||||
* Author: <jlwei@ingenic.cn>
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*
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* SPDX-License-Identifier: GPL-2.0+
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*/
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#include <common.h>
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#include <nand.h>
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#include <asm/io.h>
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#include <asm/jz4740.h>
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#define JZ_NAND_DATA_ADDR ((void __iomem *)0xB8000000)
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#define JZ_NAND_CMD_ADDR (JZ_NAND_DATA_ADDR + 0x8000)
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#define JZ_NAND_ADDR_ADDR (JZ_NAND_DATA_ADDR + 0x10000)
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#define JZ_NAND_ECC_CTRL_ENCODING BIT(3)
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#define JZ_NAND_ECC_CTRL_RS BIT(2)
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#define JZ_NAND_ECC_CTRL_RESET BIT(1)
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#define JZ_NAND_ECC_CTRL_ENABLE BIT(0)
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#define EMC_SMCR1_OPT_NAND 0x094c4400
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||||||
/* Optimize the timing of nand */
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static struct jz4740_emc * emc = (struct jz4740_emc *)JZ4740_EMC_BASE;
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static struct nand_ecclayout qi_lb60_ecclayout_2gb = {
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.eccbytes = 72,
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.eccpos = {
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||||||
12, 13, 14, 15, 16, 17, 18, 19,
|
|
||||||
20, 21, 22, 23, 24, 25, 26, 27,
|
|
||||||
28, 29, 30, 31, 32, 33, 34, 35,
|
|
||||||
36, 37, 38, 39, 40, 41, 42, 43,
|
|
||||||
44, 45, 46, 47, 48, 49, 50, 51,
|
|
||||||
52, 53, 54, 55, 56, 57, 58, 59,
|
|
||||||
60, 61, 62, 63, 64, 65, 66, 67,
|
|
||||||
68, 69, 70, 71, 72, 73, 74, 75,
|
|
||||||
76, 77, 78, 79, 80, 81, 82, 83 },
|
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||||||
.oobfree = {
|
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||||||
{.offset = 2,
|
|
||||||
.length = 10 },
|
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||||||
{.offset = 84,
|
|
||||||
.length = 44 } }
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};
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||||||
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||||||
static int is_reading;
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||||||
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static void jz_nand_cmd_ctrl(struct mtd_info *mtd, int cmd, unsigned int ctrl)
|
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||||||
{
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struct nand_chip *this = mtd->priv;
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uint32_t reg;
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||||||
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||||||
if (ctrl & NAND_CTRL_CHANGE) {
|
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||||||
if (ctrl & NAND_ALE)
|
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||||||
this->IO_ADDR_W = JZ_NAND_ADDR_ADDR;
|
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||||||
else if (ctrl & NAND_CLE)
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||||||
this->IO_ADDR_W = JZ_NAND_CMD_ADDR;
|
|
||||||
else
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||||||
this->IO_ADDR_W = JZ_NAND_DATA_ADDR;
|
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||||||
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||||||
reg = readl(&emc->nfcsr);
|
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||||||
if (ctrl & NAND_NCE)
|
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||||||
reg |= EMC_NFCSR_NFCE1;
|
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||||||
else
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||||||
reg &= ~EMC_NFCSR_NFCE1;
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||||||
writel(reg, &emc->nfcsr);
|
|
||||||
}
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||||||
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||||||
if (cmd != NAND_CMD_NONE)
|
|
||||||
writeb(cmd, this->IO_ADDR_W);
|
|
||||||
}
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||||||
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||||||
static int jz_nand_device_ready(struct mtd_info *mtd)
|
|
||||||
{
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||||||
return (readl(GPIO_PXPIN(2)) & 0x40000000) ? 1 : 0;
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||||||
}
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||||||
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||||||
void board_nand_select_device(struct nand_chip *nand, int chip)
|
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||||||
{
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||||||
/*
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||||||
* Don't use "chip" to address the NAND device,
|
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||||||
* generate the cs from the address where it is encoded.
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||||||
*/
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||||||
}
|
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||||||
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|
||||||
static int jz_nand_rs_calculate_ecc(struct mtd_info *mtd, const u_char *dat,
|
|
||||||
u_char *ecc_code)
|
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||||||
{
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||||||
uint32_t status;
|
|
||||||
int i;
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||||||
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||||||
if (is_reading)
|
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||||||
return 0;
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||||||
|
|
||||||
do {
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|
||||||
status = readl(&emc->nfints);
|
|
||||||
} while (!(status & EMC_NFINTS_ENCF));
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|
||||||
|
|
||||||
/* disable ecc */
|
|
||||||
writel(readl(&emc->nfecr) & ~EMC_NFECR_ECCE, &emc->nfecr);
|
|
||||||
|
|
||||||
for (i = 0; i < 9; i++)
|
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||||||
ecc_code[i] = readb(&emc->nfpar[i]);
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||||||
|
|
||||||
return 0;
|
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||||||
}
|
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||||||
|
|
||||||
static void jz_nand_hwctl(struct mtd_info *mtd, int mode)
|
|
||||||
{
|
|
||||||
uint32_t reg;
|
|
||||||
|
|
||||||
writel(0, &emc->nfints);
|
|
||||||
reg = readl(&emc->nfecr);
|
|
||||||
reg |= JZ_NAND_ECC_CTRL_RESET;
|
|
||||||
reg |= JZ_NAND_ECC_CTRL_ENABLE;
|
|
||||||
reg |= JZ_NAND_ECC_CTRL_RS;
|
|
||||||
|
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||||||
switch (mode) {
|
|
||||||
case NAND_ECC_READ:
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|
||||||
reg &= ~JZ_NAND_ECC_CTRL_ENCODING;
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||||||
is_reading = 1;
|
|
||||||
break;
|
|
||||||
case NAND_ECC_WRITE:
|
|
||||||
reg |= JZ_NAND_ECC_CTRL_ENCODING;
|
|
||||||
is_reading = 0;
|
|
||||||
break;
|
|
||||||
default:
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
writel(reg, &emc->nfecr);
|
|
||||||
}
|
|
||||||
|
|
||||||
/* Correct 1~9-bit errors in 512-bytes data */
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||||||
static void jz_rs_correct(unsigned char *dat, int idx, int mask)
|
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||||||
{
|
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||||||
int i;
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||||||
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||||||
idx--;
|
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||||||
|
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||||||
i = idx + (idx >> 3);
|
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||||||
if (i >= 512)
|
|
||||||
return;
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||||||
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|
||||||
mask <<= (idx & 0x7);
|
|
||||||
|
|
||||||
dat[i] ^= mask & 0xff;
|
|
||||||
if (i < 511)
|
|
||||||
dat[i + 1] ^= (mask >> 8) & 0xff;
|
|
||||||
}
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||||||
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||||||
static int jz_nand_rs_correct_data(struct mtd_info *mtd, u_char *dat,
|
|
||||||
u_char *read_ecc, u_char *calc_ecc)
|
|
||||||
{
|
|
||||||
int k;
|
|
||||||
uint32_t errcnt, index, mask, status;
|
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||||||
|
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||||||
/* Set PAR values */
|
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||||||
const uint8_t all_ff_ecc[] = {
|
|
||||||
0xcd, 0x9d, 0x90, 0x58, 0xf4, 0x8b, 0xff, 0xb7, 0x6f };
|
|
||||||
|
|
||||||
if (read_ecc[0] == 0xff && read_ecc[1] == 0xff &&
|
|
||||||
read_ecc[2] == 0xff && read_ecc[3] == 0xff &&
|
|
||||||
read_ecc[4] == 0xff && read_ecc[5] == 0xff &&
|
|
||||||
read_ecc[6] == 0xff && read_ecc[7] == 0xff &&
|
|
||||||
read_ecc[8] == 0xff) {
|
|
||||||
for (k = 0; k < 9; k++)
|
|
||||||
writeb(all_ff_ecc[k], &emc->nfpar[k]);
|
|
||||||
} else {
|
|
||||||
for (k = 0; k < 9; k++)
|
|
||||||
writeb(read_ecc[k], &emc->nfpar[k]);
|
|
||||||
}
|
|
||||||
/* Set PRDY */
|
|
||||||
writel(readl(&emc->nfecr) | EMC_NFECR_PRDY, &emc->nfecr);
|
|
||||||
|
|
||||||
/* Wait for completion */
|
|
||||||
do {
|
|
||||||
status = readl(&emc->nfints);
|
|
||||||
} while (!(status & EMC_NFINTS_DECF));
|
|
||||||
|
|
||||||
/* disable ecc */
|
|
||||||
writel(readl(&emc->nfecr) & ~EMC_NFECR_ECCE, &emc->nfecr);
|
|
||||||
|
|
||||||
/* Check decoding */
|
|
||||||
if (!(status & EMC_NFINTS_ERR))
|
|
||||||
return 0;
|
|
||||||
|
|
||||||
if (status & EMC_NFINTS_UNCOR) {
|
|
||||||
printf("uncorrectable ecc\n");
|
|
||||||
return -1;
|
|
||||||
}
|
|
||||||
|
|
||||||
errcnt = (status & EMC_NFINTS_ERRCNT_MASK) >> EMC_NFINTS_ERRCNT_BIT;
|
|
||||||
|
|
||||||
switch (errcnt) {
|
|
||||||
case 4:
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|
||||||
index = (readl(&emc->nferr[3]) & EMC_NFERR_INDEX_MASK) >>
|
|
||||||
EMC_NFERR_INDEX_BIT;
|
|
||||||
mask = (readl(&emc->nferr[3]) & EMC_NFERR_MASK_MASK) >>
|
|
||||||
EMC_NFERR_MASK_BIT;
|
|
||||||
jz_rs_correct(dat, index, mask);
|
|
||||||
case 3:
|
|
||||||
index = (readl(&emc->nferr[2]) & EMC_NFERR_INDEX_MASK) >>
|
|
||||||
EMC_NFERR_INDEX_BIT;
|
|
||||||
mask = (readl(&emc->nferr[2]) & EMC_NFERR_MASK_MASK) >>
|
|
||||||
EMC_NFERR_MASK_BIT;
|
|
||||||
jz_rs_correct(dat, index, mask);
|
|
||||||
case 2:
|
|
||||||
index = (readl(&emc->nferr[1]) & EMC_NFERR_INDEX_MASK) >>
|
|
||||||
EMC_NFERR_INDEX_BIT;
|
|
||||||
mask = (readl(&emc->nferr[1]) & EMC_NFERR_MASK_MASK) >>
|
|
||||||
EMC_NFERR_MASK_BIT;
|
|
||||||
jz_rs_correct(dat, index, mask);
|
|
||||||
case 1:
|
|
||||||
index = (readl(&emc->nferr[0]) & EMC_NFERR_INDEX_MASK) >>
|
|
||||||
EMC_NFERR_INDEX_BIT;
|
|
||||||
mask = (readl(&emc->nferr[0]) & EMC_NFERR_MASK_MASK) >>
|
|
||||||
EMC_NFERR_MASK_BIT;
|
|
||||||
jz_rs_correct(dat, index, mask);
|
|
||||||
default:
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
return errcnt;
|
|
||||||
}
|
|
||||||
|
|
||||||
/*
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|
||||||
* Main initialization routine
|
|
||||||
*/
|
|
||||||
int board_nand_init(struct nand_chip *nand)
|
|
||||||
{
|
|
||||||
uint32_t reg;
|
|
||||||
|
|
||||||
reg = readl(&emc->nfcsr);
|
|
||||||
reg |= EMC_NFCSR_NFE1; /* EMC setup, Set NFE bit */
|
|
||||||
writel(reg, &emc->nfcsr);
|
|
||||||
|
|
||||||
writel(EMC_SMCR1_OPT_NAND, &emc->smcr[1]);
|
|
||||||
|
|
||||||
nand->IO_ADDR_R = JZ_NAND_DATA_ADDR;
|
|
||||||
nand->IO_ADDR_W = JZ_NAND_DATA_ADDR;
|
|
||||||
nand->cmd_ctrl = jz_nand_cmd_ctrl;
|
|
||||||
nand->dev_ready = jz_nand_device_ready;
|
|
||||||
nand->ecc.hwctl = jz_nand_hwctl;
|
|
||||||
nand->ecc.correct = jz_nand_rs_correct_data;
|
|
||||||
nand->ecc.calculate = jz_nand_rs_calculate_ecc;
|
|
||||||
nand->ecc.mode = NAND_ECC_HW_OOB_FIRST;
|
|
||||||
nand->ecc.size = CONFIG_SYS_NAND_ECCSIZE;
|
|
||||||
nand->ecc.bytes = CONFIG_SYS_NAND_ECCBYTES;
|
|
||||||
nand->ecc.strength = 4;
|
|
||||||
nand->ecc.layout = &qi_lb60_ecclayout_2gb;
|
|
||||||
nand->chip_delay = 50;
|
|
||||||
nand->bbt_options |= NAND_BBT_USE_FLASH;
|
|
||||||
|
|
||||||
return 0;
|
|
||||||
}
|
|
||||||
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